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課程名稱 |
服務學習甲
Service Learning (a) |
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開課學期 |
111-1 |
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授課對象 |
電機資訊學院 電機工程學系 |
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授課教師 |
李峻霣 |
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課號 |
EE0004 |
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課程識別碼 |
901 001A0 |
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班次 |
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學分 |
0.0 |
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全/半年 |
半年 |
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必/選修 |
必修 |
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上課時間 |
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上課地點 |
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備註 |
本系館舍打掃。
總人數上限：30人 |
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課程簡介影片 |
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核心能力關聯 |
核心能力與課程規劃關聯圖 |
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課程大綱
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為確保您我的權利,請尊重智慧財產權及不得非法影印
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課程概述 |
DIGITAL SYSTEM DESIGN INTRODUCTION
FUNDAMENTALS OF HARDWARE DESCRIPTION LANGUAGE
LOGIC DESIGN AT REGISTER TRANSFER LEVEL
LOGIC DESIGN WITH BEHAVIOR CODING, DESIGN VALIDATION
SYNTHESIZABLE CODING OF VERILOG
CODING STYLE AND VERIFICATION TOOL
SYNTHESIS TOOL USAGE
COMPLEXITY MANAGEMENT AND PERFORMANCE IMPROVEMENT
IMPLEMENTATION PROJECT: MIPS PROCESSOR |
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課程目標 |
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課程要求 |
PREREQUISITE:
SWITCH CIRCUITS AND LOGIC DESIGNS
ELECTRONICS
GRADING:
CAD LABS AND HOMEWORK 34%
MIDTERM EXAM 28%
FINAL PROJECT 30%
IMPRESSION (ATTENDANCE AND ATTITUDE) 8% |
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預期每週課後學習時數 |
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Office Hours |
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參考書目 |
MAIN:
COURSE SLIDES.
FOR REFERENCE:
"ADVANCED DIGITAL DESIGN WITH THE VERILOG HDL," BY M. D. CILETTI, PRENTICE HALL, 2003. |
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指定閱讀 |
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評量方式
(僅供參考) |
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